Translation of "Instruction counter" in German

The instruction counter BZ serves as an input register of the instruction memory BSP.
Der Befehlszähler BZ dient als Eingangsregister des Befehlsspeichers BSP.
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Otherwise, the instruction counter BZ is merely incremented (signals ST6).
Andernfalls wird der Befehlszähler BZ lediglich weiter gezählt (Signale ST6).
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When the branch condition is not fulfilled, the instruction counter BZ is incremented in a standard way.
Wenn die Verzweigungsbedingung nicht vorliegt, wird der Befehlszähler BZ auf übliche Weise weiter gezählt.
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As is well known in the art, the instruction counter of a central unit, such as a microprocessor, only has a limited address stock.
Bekanntlich weist der Befehlszähler einer Zentraleinheit, wie eines Mikroprozessors, nur einen begrenzten Adressenvorrat auf.
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In this manner, the instruction cycle counter is stopped on cycle time T4 for two cycle times.
Auf diese Weise wird der Instruktionszykluszähler für die Dauer zweier Zykluszeiten auf der Zykluszeit T4 gehalten.
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The alternative embodiment of an instruction cycle counter also consists of flipflops 54 generating cycle times Ti.
Der alternative Instruktionszykluszähler besteht ebenfalls wieder aus Flipflop-Stufen 54, welche die Zykluszeiten Ti erzeugen.
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In the performance of the program, the operational portions of the command words of the program memory are processed according to the steps of the instruction counter, corresponding exactly to the serial-logic interconnection of the embodiments of FIGS. 12 and 13 which operate purely in hardware.
Bei der Abarbeitung des Programms werden die Operationsteile der Befehlsworte des Programmspeichers entspredhend den Schritten des Befehlszählers abgearbeitet, wie es genau der rein in hardware arbeitenden seriellen logischen Verknüpfung der Ausführungsbeispiele der Fig.12 und 13 entspricht.
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During the phase 2, the instruction counter BZ is incremented and the next instruction word is written into the instruction register BZ during phase 3.
Während der Phase 2 wird der Befehlszähler BZ weitergezählt und während der Phase 3 wird das nächste Befehlswort in das Befehlsregister BZ eingeschrieben.
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Given a branch instruction, the branch condition is checked in phase 3 and the absolute address is taken from the instruction word given an appropriate result and is loaded into the instruction counter BZ.
Bei einem Verzweigungsbefehl wird die Verzweigungsbedingung in der Phase 3 überprüft und bei entsprechendem Ergebnis die absolute Adresse aus dem Befehlswort entnommen und in den Befehlszähler BZ geladen.
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When a branch instruction is involved and when the FLAG conditions (signals ST5 from the ALU) agree, then the instruction counter BZ is loaded with the new address (signals ST3).
Handelt es sich um einen Verzweigungsbefehl und stimmen die FLAG-Bedingungen Signale ST5 von der ALU), so wird der Befehlszähler BZ mit der neuen Adresse geladen (Signale ST3).
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An instruction counter BZ in which the address under which the next instruction word to be processed is stored in the memory BSP is formed is also required for the execution.
Zum Ablauf ist weiterhin ei-n Befehlszähler BZ erforderlich, in dem die Adresse gebildet wird, unter der das nächste zu bearbeitende Befehlswort im Speicher BSP gespeichert ist.
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In this task switching, which is triggered with a microprocessor branch instruction, the microprocessor register contents, for example segment register, instruction counter, but not the interrupt descriptor table register IDTR and the global descriptor table register GDTR belonging to the currently-running task of the real-time operating system are automatically entered into the status segment RT-TSS of the real-time operating system by the microprocessor and are replaced by the corresponding values from the status segment TS-TSS belonging to the subscriber operating system.
Bei dieser Taskumschaltung, die mit einem Mikroprozessorsprungbefehl ausgelöst wird, werden vom Mikroprozessor automatisch die zur momentan laufenden Task des Echtzeit-Betriebssystems gehörenden Mikroprozessorregisterinhalte, z. B. Segmentregister, Befehlszähler, nicht aber IDTR und GDTR, in das Statussegment RT-TSS des Echtzeit-Betriebssystems eingetragen und durch die entsprechenden Werte aus dem zum Teilnehmerbetriebssystem gehörigen Statussegment TS-TSS ersetzt.
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The number of instructions is counted by an instruction counter 23, which is connected to a switch 24.
Die Anzahl der Befehle wird dabei von einem Befehlszähler 23 gezählt, der mit einem Schalter 24 verbunden ist.
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With such an instruction cycle counter 22a the operation decoder 15 can be of a less complicated structure since e.g. for the two microinstructions of the above type it merely has to generate always the same control signals for the data flow.
Mit einem solchen Instruktionszykluszähler 22a kann der Operationsdecodierer 15 einfacher konstruiert sein, da er beispielsweise für die zwei Mikroinstruktionen der genannten Art immer nur die gleichen Steuersignale für den Datenfluß zu erzeugen braucht.
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In the performance of the program, the operational portions of the command words of the program memory are processed according to the steps of the instruction counter, corresponding exactly to the serial-logic interconnection of the embodiments of FIGS.
Bei derAbarbeitung des Programms werden die Operationsteile der Befehlsworte des Programmspeichers entsprechend den Schritten des Befehlszählers abgearbeitet, wie es genau der rein in hardware arbeitenden seriellen logischen Verknüpfung der Ausführungsbeispiele der Fig.
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The data path controller is composed of the instruction register BR, of the instruction counter BZ, of the address decoder ADRDEC and of the instruction decoder BEFDEC.
Die Datenpfadsteuerung besteht aus dem Befehlsregister BR, dem Befehlszähler BZ, dem Adreßdecoder ADRDEC und dem Befehlsdecoder BEFDEC.
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Data Sheet MC 68 F 333 TS/D, Motorola 1992, already discloses a microcomputer which has, apart from the central processing unit, a programmable, non-volatile memory (flash EEPROM), input/output components, a monitoring circuit (watchdog timer), and also a volatile memory (code RAM), into which there can be written program data which can be accessed by the instruction counter of the central processing unit.
Es ist schon ein Mikrorechner aus dem Datenblatt MC 68 F 333 TS/D, Motorola 1992, bekannt, der außer der Zentraleinheit einen programmierbaren, nicht flüchtigen Speicher (Flash-EEPROM), Ein-/Ausgabe-Komponenten, einen Überwachungsschaltkreis (Watchdog-Timer), auch einen flüchtigen Speicher (Code-RAM) aufweist, in den Programmdaten einschreibbar sind, auf die der Befehlszähler der Zentraleinheit zugreifen kann.
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The subroutine itself is not indicated, but it also commences with the instruction 6, like the previously described normal program jump, whereby the contents of the address "direct", i.e. in this case the value "0", are stored in the stack adjacent the address of the instruction counter 8 stored in response to the instruction 13.
Das Unterprogramm selbst ist hier nicht näher angedeutet, beginnt jedoch ebenfalls wie beim vorher beschriebenen normalen Programmsprung mit dem Befehl 6, mit dem der Inhalt der Adresse "direct", d.h. nun der Wert "0", in den Stack im Anschluß an die beim Befehl 13 gespeicherte Adresse des Befehlszählers 8 gespeichert wird.
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Finally, by way of the instruction 5 the contents of the instruction counter 8 are stored in the stack, after which the program counter 8 is set to the address at which the sub-routine commences in the relevant segment, and at the same time a load signal for loading the contents of the register 4 into the register 2 is generated again via the OR-gate 22, the AND-gate 24 and the block 36.
Mit dem Befehl 5 wird schließlich in üblicher Weise der Inhalt des BEfehlszählers 8 im Stack abgelegt und danach der Progammzähler 8 auf die Adresse gesetzt, an der das Unterprogramm in dem betreffenden Segment beginnt, und gleichzeitig wird wieder über das ODER-Gatter 22, das UND-Gatter 24 und den Block 36 ein Ladesignal zum Laden des Inhalts des Registers 4 in das Register 2 erzeugt.
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The present invention relates to a method and to a circuit arrangement for expanding the addressing capacity of a central unit, in particular of a microprocessor, beyond the base address capacity defined by the address stock of an instruction counter.
Die Erfindung bezieht sich auf ein Verfahren und eine Schaltungsanordnung zur Erweiterung des Adressierungsvolumens einer Zentraleinheit, insbesondere eines Mikroprozessors, über den durch den Adressenvorrat eines vorgesehenen Befehlszählers gegebenen Grundadressenumfang hinaus.
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SUMMARY OF THE INVENTION Consequently, the object of the present invention is to provide, by way of a method and circuit arrangement of the type generally mentioned above, that the addressing capacity of a central unit, in particular of a microprocessor, can be expanded in a relatively simple manner beyond the address capacity defined by the address stock of the instruction counter, without the necessity of two or more central units.
Der Erfindung liegt demgemäß die Aufgabe zugrunde, einen Weg zu zeigen, wie bei einem Verfahren und einer Schaltungsanordnung der eingangs genannten Art auf-relativ einfache Weise das Adressierungsvolumen einer Zentraleinheit, insbesondere eines Mikroprozessors, über den durch den Adressenvorrat des vorgesehenen Befehlszählers gegebenen Adressenumfang hinaus erweitert werden kann, ohne daß dazu die Zentraleinheit doppelt oder mehrfach vorzusehen ist.
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