Translation of "Trigger flip-flop" in German

The Schmitt trigger 44, flip-flop 45, majority logic circuits 48 and output buffer 50, which are illustrated by means of simple component symbols, respectively correspond to the circuit arrangement in FIG.
So entsprechen die durch jeweils einfache Bauelement-Symbole wiedergegebenen Schmitt-Trigger 44, Flip-Flop 45, Majoritäts-Logik-Schaltungen 48 und Ausgangs-Puffer 50 beispielsweise jeweils der mit demselben Bezugszeichen bezeichneten Schaltungsanordnung aus Fig.
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The Schmitt trigger 44, flip-flop 45, majority logic circuits 48 and output buffer 50, which are illustrated by means of simple component symbols, respectively correspond to the circuit arrangement in FIG. 4 bearing the same reference numbers, thus comprising in each case five identical components.
So entsprechen die durch jeweils einfache Bauelement-Symbole wiedergegebenen Schmitt-Trigger 44, Flip-Flop 45, Majoritäts-Logik-Schaltungen 48 und Ausgangs-Puffer 50 beispielsweise jeweils der mit demselben Bezugszeichen bezeichneten Schaltungsanordnung aus Fig.4, umfassen also beispielsweise jeweils fünf identische Bauelemente.
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For picking-up short circuits serve, as is well-known, integrating amplifiers 16 connected to the current transformers 3 to 5 as a lowpass filter which are connected via rectifiers 17 to a Schmitt trigger and flip-flop circuit 18, and act on operational amplifiers 19.
Zur Erfassung von Kurzschlüssen, wie bekannt, dienen mit den Stromwandlern 3 bis 5 in Verbindung stehende Integrationsverstärker 16 als Tiefpaß, die über Gleichrichter 17 mit einer Schmitt-Trigger- und Flip-Flop-Schaltung 18 verbunden sind, Operationsverstärker 19 beaufschlagen.
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The resulting pulses at the collector QV 7 trigger flip-flop FFV and let its outputs Q and IQ toggle.
Die entstehenden Pulse am Kollektor QV7 triggern das Flipflop FFV. Dadurch kippen dessen Ausgänge Q und IQ.
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It can be formed as a two-edge-triggered flip-flop.
Dieses kann als zweiflankengetriggertes Flip-Flop ausgebildet sein.
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The output from comparator 8 is connected to the level controlled input of an edge-triggered flip-flop 14 .
Der Ausgang des Komparators 8 ist mit dem zustandsgesteuerten Eingang eines flankengesteuerten Flip-Flops 14 verbunden.
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This triggers the corresponding flip-flop as soon as it is triggered at the Clock CK input.
Dazu schaltet je ein Flipflop durch, sobald es am Clock CK getriggert wird.
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The output of the comparator 2 is connected to the trigger input of an edge-triggered flip-flop 1 .
Der Ausgang des Komparators 2 ist mit dem Triggereingang eines flankengetriggerten Flip-Flops 1 verbunden.
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During that time, there is present at the output of the monostable multivibrator MF5 a continuous signal which triggers a succeeding flip-flop FF2 in such a way that the NAND gate U16 allows the output pulses of the clock generator TG to pass.
Während dieser Zeit liegt am Ausgang des Monoflops MF5 ein Dauersignal an, welches ein nachgeschaltetes Flipflop FF2 so schaltet, daß das Nicht-UND-Gatter U16 für die Ausgangs- impulse des Taktgenerators TG durchlässig wird.
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As a result of this change or edge of the selection duration signal 21', the winner of the selection process (in this case with only one involved party) is stored in the edge-triggered D flip-flop element 57.
Durch diese Aenderung bzw. Flanke des Auswahldauersignals 21' wird der Gewinner.des Auswahlvorganges (in diesem Fall mit nur einem Beteiligten) im flankengetriggerten D-Kippglied 57 gespeichert.
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The edge-triggered D flip-flop element 57 with the inverted reset input is used for generating and storing a winner signal when its own user system has won the selection process.
Das flankengetriggerte D-Kippglied 57 mit invertiertem Rücksetzeingang dient dazu, ein Gewinnersignal zu erzeugen und zu speichern, wenn der eigene Teilnehmer den Auswahlvorgang gewonnen hat.
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This transition triggers a flip-flop, which changes over a phase inverter by means of which the polarity of the signal of half the horizontal frequency and hence the polarity of the current supplied to the adder by the current source is changed.
Mit diesem Übergang wird ein Flipflop angesteuert, das eine Phasenumkehrstufe umschaltet, mit der die Polarität des Signals mit der halben Horizontalfrequenz und damit die Polarität des von der Stromquelle dem Addierer zugeleiteten Stromes umgeschaltet wird.
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This unknown transit time can readily have such a value that either the pulse signal passing undelayed through the delay arrangement 5 or one of the additionally delayed individual pulse signals triggers the D-flip-flop 8 so shortly before the appearance of the next rising edge of the time base signal that the flip-flop 58 by reason of its response delay described above does not react to this rising edge so that the flip-flop 61 gives off a stop signal to the time-to-amplitude converter circuit 14 only on the appearance of the fifth signal edge.
Diese unbekannte Verzögerung kann ohne weiteres einen solchen Wert annehmen, daß entweder das unverzögert durch die Verzögerungsanordnung 5 hindurchgehende oder eines der zusätzlich verzögerten Einzeisignale das D-Flip-Flop 8 so kurz vor dem Auftreten der nächsten steigenden Flanke des Zeitbasissignals triggert, daß das Flip-Flop 58 aufgrund seiner oben geschilderten Ansprechverzögerung auf diese steigende Flanke nicht mehr reagiert, so daß das Flip-Flop 61 erst beim Auftreten der fünften Siganlflanke ein Stopp-Signal an die Zeit/Amplituden-Wandlerschaltung 14 abgibt.
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If the negative edge of the signal present at clock input C1 and at monostable flip-flop 32 comes into effect, the negatively edge-triggered monostable flip-flop 32 emits a signal acting on the clear input C2 of the D-type flip-flop 30 as a result of which the output Q of the D-type flip-flop 30 is cleared again.
Kommt die negative Flanke des am Takteingang C 1 und am Monoflop 32 anstehenden Signals zur Wirkung, so gibt das negativ flankengetriggerte Monoflop 32 ein auf den Freischalteeingang C 2 des D-Flip-Flops 30 wirkendes Signal ab, wodurch der Ausgang Q des D-Flip-Flops 30 wieder freigeschaltet wird.
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The output from zero-crossing detector 10 leads to the input of delay stage 12 which, in turn, has its output connected to the edge-triggered input of flip-flop 14 .
Der Ausgang des Nulldurchgangsdetektors 10 geht auf den Eingang einer Verzögerungsstufe 12, die wiederum mit ihrem Ausgang mit dem flankengesteuerten Eingang des Flip-Flops 14 verbunden ist.
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