Translation of "Logikanordnung" in English

Jede programmierbare Logikanordnung enthält zwei Matrizen.
Each programmable logic array contains two matrices.
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Die Ausgänge dieser Verstärker bilden die Ausgänge A1 bis A4 der programmierbaren Logikanordnung.
The outputs of these amplifiers form the outputs A1-A4 of the programmable logic array.
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Das Ausgangssignal dieses Verstärkers 7 wird einem ersten Eingang einer Logikanordnung 8 zugeführt.
An output signal of this amplifier 7 is supplied to one input of a logic array 8.
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Das Ausgangssignal der Logikanordnung 8 wird zur Steuerung der Freigabestufe 2 herangezogen.
An output signal of the logic array 8 is utilized to control the enable stage 2.
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Eine Logikanordnung verknüpft dann beide Ausgangssignale zu einem symmetrischen Ausgangssignal.
A logic configuration then links the two output signals to make one symmetrical output signal.
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Die Logikanordnung LA ist überdies auf dem Bond-out-Chip BOC integrierbar.
The logic configuration LA can also be integrated on the bond-out chip BOC.
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Es wäre also wünschenswert, eine programmierbare Logikanordnung schon vor der Programmierung zu prüfen.
Therefore, it would be desirable to check a programmable logic array before programming.
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Der Kurzschluß der Verstärkerausgänge ist jedoch auch bei einer Inbetriebnahme der unprogrammierten Logikanordnung unschädlich.
The short of the amplifier outputs, however, is also harmless when the unprogrammed logic array is placed in operation.
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Die Figur 1 zeigt die Schaltung einer programmierbaren Logikanordnung in N-MOS-Technologie mit willkürlich vorgegebener Programmierung.
FIG. 1 illustrates a circuit of a programmable logic array in NMOS technology having arbitrarily prescribed programming.
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Auf diese Weise kann die Logikanordnung innerhalb eines Zyklus des Taktsignals mehrfach ausgenutzt werden.
This enables multiple use of the logic arrangement within a cycle of the clock signal.
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Die Logikanordnung 8 besitzt entsprechend der Anzahl von zu erzeugenden Taktsignalen eine Vielzahl von Eingängen.
The logic array 8 has a number of inputs, depending on the number of clock signals to be produced.
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Die Ansteuerung wird mittels eines über eine Taktleitung 8 gesteuerten Synchronisierschaltung 11, bestehend aus einem FET,synchronisiert, die zwischen der Logikanordnung 7 und der betreffenden Einzelquelle 6 liegt.
The drive is synchronized by means of a synchronizing circuit 11 controlled by a clock line 8. The synchronizing circuit 11 is formed of an FET, which is connected between the logic device 7 and the corresponding individual source 6.
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Über eine Logikanordnung LA besteht über mindestens einen Teil der Anschlußklemmen AK der Schaltungsanordnung SA ein direkter Zugriff auf die Speichereinrichtung SE zum Zwecke des Programmierens oder Kontrollierens und dem damit verbundenen Auslesen der in dieser Speichereinrichtung SE gespeicherten Daten.
A logic configuration LA provides direct access to the memory device SE for programming or monitoring and for the associated read-out of the data stored in the memory device SE, over at least some of the connection terminals AK of the circuit configuration SA.
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Diese Betriebsart ist für die Programmierungen notwendig und wird über die Logikanordnung LA dann eingestellt, wenn EA, RESET und P25 einen Low-Pegel aufweisen und damit das Freigabesignal an der Steuerklemme STE3 des ersten Buffers Bu 1 gleich "L" wird.
This mode of operation is necessary for programming and is established through the logic configuration LA whenever EA, RESET and P25 have a low level, causing the enable signal at the control terminal STE3 of the first buffer Bu 1 to become equal to "L".
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Vor allem in sequentiellen Schaltungen, bei denen die Summenleitungen beispielsweise mit den Dateneingängen von D-Flipflops verbunden sind, ist es häufig wünschenswert, in die Flipflops unabhängig von den an den Eingängen der Logikanordnung anliegenden Variablen ein externes Datum zu laden.
Particularly in sequential circuits wherein the sum lines are, for example, connected to the data inputs of D flip-flops, it is frequently desirable to load an external datum into the flip-flops independently of the variables applied to the inputs of the logic array.
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Für das Testen der normalen Verknüpfungsfunktionen der Logikanordnung über die Anschlusspunkte D1 bis D4 muss dann für die Signale auf den Steuerleitungen gelten SS1 * = L, SS2 * = H, wobei L für den niederen und H für den hohen binären Signalpegel der Steuersignale gesetzt ist.
SS1*=L, SS2*=H must then apply for the signals on the control lines for testing the normal logic operations of the logic array over the terminal points D1-D4, whereby L stands for the low binary signal level of the control signals and H stands for the high binary signal level of the control signals.
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Daraus ergibt sich eine mit Hilfe des Steuersignals SS der zweiten Logikanordnung wählbare Verschlüsselung der ursprünglichen Verknüpfungsfunktionen.
An encoding of the original logic functions selectable with the assistance of the control signal SS of the second logic arrangement derives therefrom.
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Im Endzustand der Logikanordnung sind an entsprechend der Programmierung ausgewählten Kreuzungsstellen der Eingangsleitungen mit Produkttermleitungen Koppelelemente wirksam, mit deren Hilfe logische Verknüpfungen von nichtinvertierten und/oder invertierten Eingangssignalen ausgeführt werden.
In the final condition of the logic array, coupling elements with whose assistance logic operations of non-inverted and/or inverted input signals are executed are effective at intersections of the input lines with product term lines selected in accordance with the programming of the logic array.
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Das gleiche trifft häufig auch auf die Ausgänge der Summenmatrix zu, wenn nämlich auf die programmierbare Logikanordnung innerhalb eines integrierten Bausteins weitere Schaltungsanordnungen folgen.
The same also frequently applies to outputs of the sum matrix when, in particular, further circuit arrangements follow the programmable logic array within an integrated module;
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Der Erfindung liegt die Aufgabe zugrunde, eine auf der Grundlage der ECL-Technik ausgeführte programmierbare Logikanordnung mit geringem zusätzlichen Aufwand so auszubilden, daß ihre Prüfung vor der Programmierung möglich ist, und ein Verfahren zu ihrer Prüfung anzugeben.
SUMMARY OF THE INVENTION The object of the present invention, therefore, is to provide a programmable logic array which is constructed on the basis of ECL technology and having a low additional expense such that checking is possible before programming and to specify a method for checking such a programmable logic array.
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Sie dienen neben der schon erwähnten Aufteilung der Summer-matrix dazu, die programmierbare Logikanordnung prüfbar zu machen.
In addition to the aforementioned division of the sum-matrix, they also serve to adapt the programmable logic array for checking.
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Abhängig von der Grösse der beiden Matrizen einer programmierbaren Logikanordnung lässt sich eine mehr oder weniger grosse Vielfalt von komplexen logischen Funktionen realisieren, die in ihrer Art durch die Progammierung bestimmt sind.
Depending on the size of the two matrices of a programmable logic array, a more or less great multitude of complex logical functions can be realized, their type being determined by the programming.
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Das gleiche trifft häufig auch auf die Ausgänge der Summenmatrix zu, wenn nämlich auf die programmierbare Logikanordnung innerhalb eines integrierten Bausteines weitere Schaltungsanordnungen folgen.
The same also frequently applies to outputs of the sum matrix when, in particular, further circuit arrangements follow the programmable logic array within an integrated module;
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